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第1题

已知右移移位寄存器现态为1101，其次态为 A.1001或0110 B.1011或1010 C.1110或0110 D.0010或0101
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第2题

在下列逻辑电路中，不是组合逻辑电路的有 A.译码器 B.编码器 C.计数器 D.全加器
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第3题

JK触发器要求状态由0→1，其输入信号应为 A.JK=1× B.JK=0× C.JK=×0 D.JK=×1
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第4题

对于CMOS门电路，多余端不允许 A.与有用端并联 B.悬空 C.接电源 D.接低电平
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