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第1题

在下列逻辑电路中，不是组合逻辑电路的有 A.译码器 B.编码器 C.计数器 D.全加器
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第2题

JK触发器要求状态由0→1，其输入信号应为 A.JK=1× B.JK=0× C.JK=×0 D.JK=×1
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第3题

对于CMOS门电路，多余端不允许 A.与有用端并联 B.悬空 C.接电源 D.接低电平
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第4题

下列各种电路结构的触发器中不能构成移位寄存器的是 A.电位触发器 B.主从触发器 C.边沿触发器 D.维持阻塞触发器
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