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第1题

一个数据选择器的地址输入端有3个时，最多可以有（ ）个数据信号输出 (A) 4 (B) 6 (C) 8 (D) 16
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第2题

L=AB+C 的对偶式为 (A) A+BC (B) （ A+B ） C (C) A+B+C (D) ABC
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第3题

半加器和的输出端与输入端的逻辑关系是 (A) 与非 (B) 或非 (C) 与或非 (D) 异或
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第4题

TTL 集成电路 74LS138 是３ / ８线译码器，译码器为输出低电平有效，若输入为 A 2 A 1A 0 =101 时，输出 (A) 00100000 (B) 11011111 (C) 11110111 (D) 000
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